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VHDL语言
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填空题
在VHDL的常用对象中，信号、（）可以被多次赋予不同的值，常量只能在定义时赋值。
【参考答案】
变量
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1_Digital标识符合法吗？否，\12@+\呢？（）。
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设D0为’1’，D1为’0’，D2为’1’，D3为’0’，D3&D2&D1&D0的运算结果是“0101”，D1&D2&D3&D4的运算结果是“（）”。
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