单项选择题
在Verilog HDL语言中，5‘D25是一个整数型数据，表示（）。
A.该数据二进制形式位宽为5
B.该数据十六进制形式为25
C.该数据八进制形式为25
D.该数据二进制形式位宽为2
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多项选择题
属于Verilog HDL关键字/内部保留字的有（）。
A.module
B.begin
C.cnt
D.or -
多项选择题
下列属于合法标识符的有（）。
A.reg_out
B._count_
C.8_data
D.out_% -
单项选择题
（）是将电路模块的逻辑描述文件根据选定的FPGA器件类型的结构和约束条件进行编译、优化和转换，生成可实现的门级电路的网表文件。
A.逻辑综合
B.布局布线
C.时序仿真
D.编程下载
