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VHDL语言
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VHDL可以采用层次化的设计，一个高层的结构体中可以调用低层的实体
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传统的系统硬件设计方法是采用自上而下（top down）的设计方法，利用硬件描述语言（HDL）的硬件电路设计方法采用自下而上（bottom up）的设计方法。
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