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论述题
DCVSL逻辑门的详细工作过程分析。
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问答题
确定组合逻辑延时最小的尺寸。如图所示,它代表一个复杂逻辑电路的关键路径,输出负载是一个电容,为第一级输入电容的5倍,所以路径 等效扇出F=CL/Cg1=5 。
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